成人二区_www.久久久_伊人电院网_99re国产_91在线视频播放_午夜精品久久久久久

<cite id="8m8yg"></cite>

<rt id="8m8yg"></rt>

FPGA培訓(xùn)

FPGA培訓(xùn)技術(shù)資料

FPGA培訓(xùn)-語法要點（一）

FPGA培訓(xùn)-語法要點（二）

FPGA培訓(xùn)-語法要點（三）

FPGA培訓(xùn)-語法要點（四）

FPGA培訓(xùn)-語法要點（五）

FPGA培訓(xùn)-語法要點（六）

FPGA培訓(xùn)-語法要點（一） -2010年01月21日

FPGA Verilog HDL語言中module之間的調(diào)用要點

1.module之間如何調(diào)用
2..v的文件之間的關(guān)系
3.調(diào)用不在工程中的.v文件中的
module怎么辦？

注意：
a.一個工程中用多個.v的文件，
只有一個Top，多個Sub文件
b.module之間調(diào)用遵循一個原則：
從頂層的module調(diào)用從屬的module
c.include的使用原則：
在同一個工程中不使用，在不同工程
中調(diào)用要使用。格式如下：
'include “l(fā)cd.v”

d.怎樣調(diào)用：
lcd test(.data_in(rx_ascii),.clk(clk));

滬ICP備09007944號 ?2010 Shanghai66.cn 版權(quán)所有 E-mail:congxinc@163.com